📘 硅光工艺与CMOS产线兼容性设计
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01
硅光技术概述
硅光子的发展历程
核心优势
与CMOS电芯片异同
02
CMOS工艺平台基础
制造流程简介
关键工艺模块
PDK概念
03
硅光工艺模块 (一)
硅波导与耦合器
刻蚀对损耗影响
浅刻蚀与深刻蚀
04
硅光工艺模块 (二)
锗硅光电探测器
外延生长工艺
响应度与暗电流
05
硅光工艺模块 (三)
调制器制造
PN结掺杂
调制效率与损耗
06
硅光工艺模块 (四)
热光移相器与电极
金属化影响
电极材料选择
07
硅光工艺模块 (五)
边缘/光栅耦合器
刻蚀深度与周期
耦合效率容差
08
CMOS兼容性 (一)
热预算冲突
锗硅外延温度
RTP影响
09
CMOS兼容性 (二)
金属污染控制
锗/金污染风险
阻挡层与吸杂
10
CMOS兼容性 (三)
应力管理
波导与栅极应力
SMT兼容性
11
CMOS兼容性 (四)
形貌与平坦化
CMP挑战
虚拟填充策略
12
集成方案 (一)
单片集成
Photonic-First
优缺点分析
13
集成方案 (二)
CMOS-First流程
低温硅光工艺
对器件性能影响
14
集成方案 (三)
异质集成
晶圆键合技术
对准精度要求
15
集成方案 (四)
3D堆叠与TSV
TSV对波导布局
热机械可靠性
16
工艺设计套件 (PDK)
硅光PDK差异
光器件模型
工艺角定义
17
光刻工艺兼容性
分辨率要求
DUV/EUV适用性
套刻精度影响
18
刻蚀工艺兼容性
均匀性控制
负载效应
Bosch vs 连续刻蚀
19
薄膜沉积兼容性
氧化硅/氮化硅
应力与均匀性
低温沉积技术
20
CMP兼容性
CMP选择性
碟形/侵蚀控制
后清洗影响
21
掺杂与退火兼容性
掺杂激活
RTP与尖峰退火
掺杂分布影响
22
金属化与互连兼容性
接触电阻优化
金属反射影响
铜扩散阻挡层
23
可靠性测试与失效
老化测试
温度循环/湿度
分层裂纹失效
24
设计-工艺协同优化
布局对工艺窗口
OPC在硅光应用
工艺容差设计
25
测试与表征兼容性
WAT与光测试整合
探针卡设计
光电同步测试
26
量产与良率提升
良率影响因素
缺陷检测分类
良率模型建立
27
工艺整合案例 (一)
100G/400G模块
关键工艺参数
流片经验
28
工艺整合案例 (二)
LiDAR硅光芯片
大尺寸OPA挑战
工艺整合
29
工艺整合案例 (三)
量子计算/生物传感
超低损耗波导
悬浮波导
30
未来趋势与挑战
先进节点集成
新型材料兼容性
AI驱动优化