⚡ 高速接口 · 信号完整性
FPGA 实战
📘 风格 · 30章全彩目录
01
高速接口概述
并行/串行
DDR
PCIe
SerDes
LVDS
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02
信号完整性基础
反射振铃
过冲下冲
传输线效应
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03
传输线理论
特性阻抗
微带线
带状线
传播延迟
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04
反射与端接
源端端接
并联/AC
戴维南
电阻计算
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05
串扰分析
NEXT/FEXT
容性耦合
感性耦合
差分
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06
电源完整性基础
PDN
目标阻抗
去耦电容
SSN
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07
时序分析基础
建立/保持时间
Skew
Jitter
时序裕量
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08
时钟设计
时钟树
门控时钟
CDC
全局/区域
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09
LVDS接口设计
电气特性
PCB布线
终端匹配
摄像头/显示屏
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10
DDR接口设计
DDR3/4/LPDDR4
Fly-by
数据眼图
读写时序
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11
SerDes接口设计
PCS+PMA
8B/10B
CDR
预加重/均衡
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12
PCIe接口设计
事务层/数据链路层/物理层
Gen1~Gen4
DMA
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13
JESD204B接口设计
确定性延迟
多链路同步
ADC/DAC
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14
MIPI接口设计
D-PHY
CSI-2/DSI
高速/低功耗
数据通道
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15
高速ADC/DAC接口
JESD204B/LVDS/CMOS
DDC/DUC
采样时钟抖动
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16
PCB叠层设计
层叠结构
参考平面
阻抗控制
FR4/高频材料
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17
高速布线规则
差分对
等长蛇形线
3W/20H
过孔
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18
仿真工具入门
IBIS/SPICE
TDR/TDT
S参数
HyperLynx/ADS
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19
IBIS模型使用
I/V V/T曲线
模型验证
IBIS-AMI
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20
S参数分析
S11/S21
差分S参数
去嵌
回波/插入损耗
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21
眼图分析
眼高/眼宽
抖动
BER浴盆
模板测试
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22
抖动分析
RJ/DJ
总抖动TJ
抖动分离
相位噪声
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23
预加重与均衡
Pre-emphasis
CTLE/DFE/FFE
自适应均衡
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24
高速PCB材料
Dk/Df
Rogers/Megtron
低损耗
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25
过孔设计
寄生参数
残桩Stub
背钻
过孔建模
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26
电源去耦设计
电容频率特性
目标阻抗法
PDN仿真
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27
电磁兼容 (EMC)
EMI机理
共模/差模
屏蔽滤波
PCB布局
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28
测试与验证
示波器/探头
TDR/VNA
一致性测试
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29
高速接口调试
眼图闭合
误码率高
时序违规
案例分析
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30
综合项目实战
10Gbps SerDes
Xilinx FPGA
原理图→PCB→测试
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