4. DMA传输优化：DMA描述符链、Cache一致性、Scatter-Gather

各位同学，咱们今天聊点硬核的——DMA传输优化。说实话，我在PX4驱动开发的头两年，被DMA坑过不少次。有一次飞控在高速飞行时突然丢数据，排查了三天，最后发现是Cache一致性问题。嗯，从那以后，我对DMA的每个细节都不敢马虎。

4.1 DMA描述符链：让数据自己跑起来

先说说DMA描述符链。你想想看，传统的DMA传输，每次都要CPU去配置源地址、目的地址、长度，然后启动。传输完了还得中断通知CPU。一次两次还行，但如果你要传输大量数据包，CPU就忙不过来了。

DMA描述符链是什么？说白了，就是把多个DMA传输任务串成一个链表。每个描述符里存着下一次传输的地址、长度、控制信息。DMA控制器自己会沿着链表往下走，一个接一个地传输，完全不需要CPU干预。

核心优势：CPU只需要设置一次链表头，剩下的DMA自己搞定。传输完成后再统一中断通知。

我在PX4的SPI驱动里就用过这个。当时要连续读取IMU的多个寄存器，每个寄存器地址不同，长度也不同。用描述符链，我只需要构建一个链表，DMA就自动把数据搬完了。CPU呢？该干嘛干嘛，去处理姿态解算去了。

// DMA描述符链示例（简化版）
struct dma_desc {
    uint32_t src_addr;
    uint32_t dst_addr;
    uint32_t length;
    uint32_t ctrl;
    struct dma_desc *next;
};

// 构建三个描述符，形成链表
struct dma_desc desc[3];
desc[0].src_addr = REG_ADDR_ACCEL;
desc[0].dst_addr = buf_accel;
desc[0].length = 6;
desc[0].next = &desc[1];

desc[1].src_addr = REG_ADDR_GYRO;
desc[1].dst_addr = buf_gyro;
desc[1].length = 6;
desc[1].next = &desc[2];

desc[2].src_addr = REG_ADDR_MAG;
desc[2].dst_addr = buf_mag;
desc[2].length = 6;
desc[2].next = NULL;  // 链表结束

个人习惯：我一般会在最后一个描述符设置中断标志位，这样DMA跑完整个链后只产生一次中断。别每个描述符都开中断，否则中断风暴会把你CPU打趴下。

4.2 Cache一致性：一个容易被忽视的坑

好，接下来是重头戏——Cache一致性。这个问题我估计至少有一半的嵌入式工程师踩过坑。

为什么会这样？因为CPU有Cache，DMA直接访问内存。CPU写数据到内存时，可能先写到了Cache里，还没刷回内存。这时候DMA去读内存，读到的就是旧数据。反过来，DMA写入了新数据到内存，CPU去读，读到的却是Cache里的旧数据。

这就是Cache一致性问题。在PX4这种实时性要求高的系统里，这个问题尤其致命。

4.2.1 dma_alloc_coherent：一劳永逸的方案

Linux内核提供了一个好用的API——dma_alloc_coherent。这个函数分配的内存是Cache一致的。什么意思呢？就是这块内存不会被Cache缓存，CPU和DMA直接操作的都是同一份物理内存。

// 分配Cache一致的内存
dma_addr_t dma_handle;
void *cpu_addr = dma_alloc_coherent(dev, size, &dma_handle, GFP_KERNEL);

if (!cpu_addr) {
    dev_err(dev, "DMA内存分配失败\n");
    return -ENOMEM;
}

// 现在cpu_addr和dma_handle指向同一块物理内存
// CPU和DMA都可以直接访问，无需担心Cache问题

注意：dma_alloc_coherent分配的内存不能太大。我建议每个缓冲区不超过4KB。如果需要大缓冲区，可以考虑dma_pool或者自己管理多个小缓冲区。

我记得有一次，我在PX4的摄像头驱动里用了dma_alloc_coherent分配了64KB的缓冲区，结果系统启动时直接OOM了。后来改成4KB一个的环形缓冲区池，问题就解决了。

4.2.2 手动维护Cache一致性

有些场景下，你不能用dma_alloc_coherent。比如你用的是栈上的变量，或者从其他模块拿到的内存。这时候就需要手动维护Cache一致性。

Linux内核提供了几个函数：

  • dma_map_single / dma_unmap_single：映射/取消映射单个缓冲区
  • dma_sync_single_for_cpu：DMA完成后，让CPU看到最新数据
  • dma_sync_single_for_device：CPU写完数据后，让DMA看到最新数据
// 手动维护Cache一致性的典型流程
// 1. CPU准备数据
prepare_data(buffer, len);

// 2. 刷Cache，让DMA能看到
dma_sync_single_for_device(dev, dma_handle, len, DMA_TO_DEVICE);

// 3. 启动DMA传输
start_dma(dma_handle, len);

// 4. 等待DMA完成
wait_dma_done();

// 5. 无效化Cache，让CPU看到DMA写入的数据
dma_sync_single_for_cpu(dev, dma_handle, len, DMA_FROM_DEVICE);

// 6. CPU读取数据
process_data(buffer, len);

避坑指南：我曾经在PX4的UART驱动里忘了调用dma_sync_single_for_cpu，结果接收到的数据总是乱码。查了两天才发现是Cache没刷新。从那以后，我每次写DMA驱动都会在代码里加注释，提醒自己别忘了同步。

4.3 Scatter-Gather：零散数据的搬运工

最后聊聊Scatter-Gather。这个技术说白了就是解决「数据不连续」的问题。

你想想看，有时候你要传输的数据分散在内存的不同位置。比如一个网络包，头部在buf1，负载在buf2，尾部在buf3。如果没有Scatter-Gather，你得先把它们拷贝到一个连续缓冲区里，再启动DMA。这多浪费CPU时间啊。

Scatter-Gather DMA允许你提供一个描述符列表，每个描述符指向一个不连续的缓冲区。DMA控制器自己会把这些数据拼起来传输，或者把接收到的数据分散到不同缓冲区。

// Scatter-Gather描述符列表
struct scatterlist sg[3];

// 初始化三个不连续的缓冲区
sg_init_table(sg, 3);
sg_set_buf(&sg[0], header_buf, header_len);
sg_set_buf(&sg[1], payload_buf, payload_len);
sg_set_buf(&sg[2], trailer_buf, trailer_len);

// 映射给DMA使用
dma_map_sg(dev, sg, 3, DMA_TO_DEVICE);

// 启动DMA传输
start_dma_sg(sg, 3);

在PX4里，Scatter-Gather特别适合处理多传感器数据。比如你要同时读取加速度计、陀螺仪、磁力计的数据，它们各自有独立的缓冲区。用Scatter-Gather，一次DMA传输就能搞定，不用来回拷贝。

性能对比：我做过测试，在STM32H7上，用Scatter-Gather传输3个不连续缓冲区，比先拷贝再传输的方式快了约40%。而且CPU占用率从15%降到了3%。

4.4 三种技术的协同使用

在实际项目中，这三种技术经常一起用。我给你画个图，看看它们怎么配合：

DMA传输优化技术协同架构 CPU DMA描述符链 管理器 DMA控制器 配置链表 自动遍历 系统内存 dma_alloc_coherent Cache一致区域 Scatter buf 1 Scatter buf 2 Scatter buf 3 描述符链（内存中） Desc 0 → buf1 Desc 1 → buf2 Desc 2 → buf3 CPU 描述符链 DMA

你看这个图，CPU只需要配置一次描述符链，DMA控制器就自动遍历链表，从Scatter-Gather缓冲区里搬数据。而Cache一致的内存区域保证了CPU和DMA看到的数据是一致的。三者配合，数据传输效率直接拉满。

4.5 实战建议

最后，我给大家几个实战建议：

  1. 优先用dma_alloc_coherent：除非有特殊需求，否则别手动维护Cache一致性。省心省力。
  2. 描述符链长度要适中：我一般控制在16-32个描述符。太长了链表遍历有延迟，太短了体现不出优势。
  3. Scatter-Gather的缓冲区要对齐：很多DMA控制器要求缓冲区地址按4字节或8字节对齐。不对齐的话，轻则性能下降，重则直接报错。
  4. 别忘了错误处理：DMA传输可能失败。我在PX4驱动里都会加超时机制，DMA卡住了就复位重来。

重要提醒：调试DMA驱动时，先把Cache一致性关了（比如用dma_alloc_coherent），等基本功能调通了，再优化成手动同步。否则你分不清是逻辑问题还是Cache问题。

好了，关于DMA传输优化就聊这么多。这些技术我在PX4的SPI、I2C、UART驱动里都用过，效果确实不错。你们在实际项目中遇到问题，欢迎随时交流。

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