4、6层板叠层设计：典型6层板叠层方案、信号层与平面层分配、多电源域处理

好，咱们接着聊多层板。上一章讲了4层板，说白了那是入门级的。真正让硬件工程师开始头疼的，是从6层板开始的。为什么？因为6层板给了你更多自由度，但也给了你更多犯错的机会。

我个人习惯把6层板叫做「黄金层数」。为什么？你想想看，4层板往往只能勉强搞定一组电源和地，信号层也就两层。但到了6层，你可以开始玩「叠层艺术」了——信号层、地层、电源层怎么分配，直接决定了你的板子能不能稳定工作。

4.1 典型6层板叠层方案

先给大家看一个我项目里最常用的叠层方案。这个方案我用了至少七八年，从FPGA板到高速ADC板都验证过，非常稳。

典型6层板叠层方案（推荐）
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Layer 1 (Top)    : 信号层 + 关键器件
Layer 2 (GND)    : 完整地平面
Layer 3 (Signal) : 信号层（水平走线）
Layer 4 (PWR)    : 电源平面（可分割）
Layer 5 (GND)    : 完整地平面
Layer 6 (Bottom) : 信号层 + 次要器件
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这个方案的核心思路是什么？信号层紧邻地平面。你看，L1和L2之间是紧耦合，L5和L6之间也是紧耦合。L3信号层上下都有参考平面（L2和L4），阻抗控制非常容易做。

当然，还有另一种常见方案，适合对电源质量要求特别高的场景：

备选方案（电源优先）
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Layer 1 (Top)    : 信号层
Layer 2 (GND)    : 完整地平面
Layer 3 (PWR)    : 电源平面（主电源）
Layer 4 (GND)    : 完整地平面
Layer 5 (Signal) : 信号层
Layer 6 (Bottom) : 信号层
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这个方案把电源层也夹在两个地层之间，电源纹波抑制效果更好。但代价是信号层只有三层，而且L5和L6之间没有地平面隔离，串扰会大一些。我在一个射频项目里用过这个方案，当时是因为电源噪声太敏感，不得不牺牲一点信号质量。

4.2 信号层与平面层分配

信号层分配，说白了就是「谁走什么线」的问题。我见过太多新手把高速信号和低速信号混在一起走，结果板子调得想哭。

我的分配原则很简单：

• L1（顶层）：走最关键的信号。比如时钟线、高速差分对、DDR数据线。因为顶层离器件最近，过孔最少。
• L3（中间信号层）：走次关键信号。比如控制信号、地址线、中速总线。水平方向走线，和顶层形成正交布线，减少层间串扰。
• L6（底层）：走低速信号和辅助信号。比如I2C、GPIO、复位信号。偶尔放一些去耦电容。

平面层分配呢？L2和L5必须是完整地平面，这个没得商量。L4是电源平面，但这里有个坑——电源平面往往需要分割。

4.3 多电源域处理

现在的板子，哪个不是一堆电源？3.3V、1.8V、1.2V、0.9V...全挤在一个电源层上。怎么办？分割。

我曾经在一个项目里遇到过这样的问题：板子上有模拟3.3V和数字3.3V，我把它们放在同一个电源层上，中间只隔了一条20mil的隔离带。结果ADC的SNR直接掉了6dB。后来我把隔离带加宽到50mil，又在隔离带下方加了一条地线，问题才解决。

多电源域处理的核心原则：

1. 分割要宽：不同电源域之间的隔离带至少20mil，推荐30-50mil。别心疼那点面积。
2. 避免跨分割：信号线绝对不能跨越电源分割区域。如果非要跨，必须在相邻层提供回流路径。
3. 星形连接：多个电源域的回流路径要独立，最后在一点汇合。别搞成菊花链。
4. 磁珠隔离：模拟和数字电源之间用磁珠隔离，但要注意磁珠的直流电阻和频率特性。

下面这张图是我手绘的6层板叠层结构，你可以直观地看到信号层和平面层的关系：

最后说一个我踩过的坑。有一次做6层板，L4电源层上同时有3.3V和1.8V，分割带只有15mil。结果1.8V区域的去耦电容回流路径被分割带切断，导致1.8V电源纹波高达80mV。后来我把分割带加宽到40mil，又在分割带下方L5地层上加了缝合过孔，纹波降到了15mV以下。

嗯，这就是经验。有些东西，书上不会写那么细，只有自己吃过亏才知道。

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